7/18/2019 Arquitectura Harvard

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INSTITUTO TECNOLÓGICO SUPERIOR DE JEREZINGENIERÍA MECATRÓNICA

MICROCONTROLADORES ICE. OSCAR GABRIEL CARRERA GARCÍA

 ARQUITECTURA HARVARD

JAVIER DORADO ROMERO NO. CONTROL: 11070045

21 DE AGOSTO DE 2014

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 ARQUITECTURA HARVARD

Este modelo, que utilizan los microcontroladoresPIC, tiene la unidad central de proceso (CPU)conectada a dos memorias (una con las instrucciones

 y otra con los datos) por medio de dos busesdiferentes.

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FUNCIONAMIENTO

Una de las memorias contiene solamente lasinstrucciones del programa (Memoria de Programa), y laotra sólo almacena datos (Memoria de Datos).

 Ambos buses son totalmente independientes lo quepermite que la CPU pueda acceder de formaindependiente y simultánea a la memoria de datos y a lade instrucciones. Como los buses son independienteséstos pueden tener distintos contenidos en la misma

dirección y también distinta longitud. También lalongitud de los datos y las instrucciones puede serdistinta, lo que optimiza el uso de la memoria en general.

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Para un procesador de Set de InstruccionesReducido, o RISC (Reduced Instrucción SetComputer), el set de instrucciones y el bus dememoria de programa pueden diseñarse de talmanera que todas las instrucciones tengan una solaposición de memoria de programa de longitud.

 Además, al ser los buses independientes, la CPU

puede acceder a los datos para completar laejecución de una instrucción, y al mismo tiempo leerla siguiente instrucción a ejecutar.

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 VENTAJAS

· El tamaño de las instrucciones no esta relacionadocon el de los datos, y por lo tanto puede seroptimizado para que cualquier instrucción ocupe unasola posición de memoria de programa, logrando asímayor velocidad y menor longitud de programa.

· El tiempo de acceso a las instrucciones puede

superponerse con el de los datos, logrando unamayor velocidad en cada operación.

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Fuente

http://www.fing.edu.uy/tecnoinf/mvd/cursos/arqcomp/material/teorico/arq-teorico05.pdf