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1 Universidad de Pamplona Pamplona - Norte de Santander - Colombia Tels: (7) 5685303 - 5685304 - 5685305 - Fax: 5682750 - www.unipamplona.edu.co Una universidad incluyente y comprometida con el desarrollo integral PRIMER LABORATORIO LÓGICA DIGITAL DISEÑO DE CIRCUITOS LÓGICOS COMBINACIONALES Presentado por YASERT DAVID PÉREZ ARAQUE ANDREA CAROLINA REALES UNIVERSIDAD DE PAMPLONA FACULTAD DE INGENIERIAS Y ARQUITECTURA LÓGICA DIGITAL PAMPLONA ABRIL 2016

informe logica

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Universidad de Pamplona Pamplona - Norte de Santander - Colombia

Tels: (7) 5685303 - 5685304 - 5685305 - Fax: 5682750 - www.unipamplona.edu.co

Una universidad incluyente y comprometida con el desarrollo integral

PRIMER LABORATORIO LÓGICA DIGITAL DISEÑO DE CIRCUITOS LÓGICOS COMBINACIONALES

Presentado por YASERT DAVID PÉREZ ARAQUE

ANDREA CAROLINA REALES

UNIVERSIDAD DE PAMPLONA FACULTAD DE INGENIERIAS Y ARQUITECTURA

LÓGICA DIGITAL PAMPLONA ABRIL 2016

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Tels: (7) 5685303 - 5685304 - 5685305 - Fax: 5682750 - www.unipamplona.edu.co

Una universidad incluyente y comprometida con el desarrollo integral

OBJETIVO

Reconocer, utilizar y conjugar cada uno de los dispositivos vistos en el desarrollo de

la materia, para diseñar circuitos lógicos combinatorios con el fin de solucionar

problemas de forma eficiente y económica

MATERILAES

2 integrados 74LS08

1 integrado 74LS00

1 integrado 74LS86

Resistencias 220Ω

1 Dip swich 4 posiciones

Leds

Protoboard

Cable UTP

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PROCEDIMIENTO:

Se realiza una tabla con cada una de las combinaciones posibles con los números binarios de

dos bits para establecer cada una de las salidas

𝑿𝟎 𝑿𝟏 𝒀𝟎 𝒀𝟏 𝒁𝟎 𝒁𝟏 𝒁𝟐 𝒁𝟑

0 0 0 0 0 0 0 0

0 0 0 1 0 0 0 0

0 0 1 0 0 0 0 0

0 0 1 1 0 0 0 0

0 1 0 0 0 0 0 0

0 1 0 1 0 0 0 1

0 1 1 0 0 0 1 0

0 1 1 1 0 0 1 1

1 0 0 0 0 0 0 0

1 0 0 1 0 0 1 0

1 0 1 0 0 1 0 0

1 0 1 1 0 1 1 0

1 1 0 0 0 0 0 0

1 1 0 1 0 0 1 1

1 1 1 0 0 1 1 0

1 1 1 1 1 0 0 1

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Salida 𝒁𝟎

𝒁𝟎 = 𝑿𝟎 𝑿𝟏 𝒀𝟎 𝒀𝟏

Circuito con compuertas lógicas para la salida 𝒁𝟎

Salida 𝒁𝟏

𝒁𝟎 𝒀𝟎 𝒀𝟏

𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏

𝑿𝟎 𝑿𝟏

0 0 0 0

𝑿𝟎 𝑿𝟏 0 0 0 0

𝑿𝟎 𝑿𝟏 0 0 1 0

𝑿𝟎 𝑿𝟏 0 0 0 0

𝒁𝟏 𝒀𝟎 𝒀𝟏

𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏

𝑿𝟎 𝑿𝟏

0 0 0 0

𝑿𝟎 𝑿𝟏 0 0 0 0

𝑿𝟎 𝑿𝟏 0 0 0 1

𝑿𝟎 𝑿𝟏 0 0 1 1

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𝒁𝟏 = 𝑿𝟎𝑿𝟏 𝒀𝟎 + 𝑿𝟎 𝒀𝟎 𝒀𝟏

𝒁𝟏 = 𝑿𝟎𝒀𝟎( 𝑿𝟏 + 𝒀𝟏

)

𝒁𝟏 = 𝑿𝟎𝒀𝟎 𝑿𝟏 𝒀𝟏

Circuito con compuertas lógicas para la salida 𝒁𝟏

Salida 𝒁𝟐

𝑍2 𝒀𝟎 𝒀𝟏

𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏

𝑿𝟎 𝑿𝟏

0 0 0 0

𝑿𝟎 𝑿𝟏 0 0 1 1

𝑿𝟎 𝑿𝟏 0 1 0 1

𝑿𝟎 𝑿𝟏 0 1 1 0

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𝒁𝟐 = 𝑿𝟎𝒀𝟎 𝒀𝟏 + 𝑿𝟎 𝑿𝟏

𝒀𝟏 + 𝑿𝟎 𝑿𝟏𝒀𝟎 + 𝑿𝟏𝒀𝟎𝒀𝟏

𝒁𝟐 = 𝑿𝟎𝒀𝟏( 𝒀𝟎 + 𝑿𝟏

) + 𝑿𝟏𝒀𝟎(𝑿𝟎 + 𝒀𝟏

)

𝒁𝟐 = 𝑿𝟎𝒀𝟎 𝑿𝟏

𝒀𝟏 + 𝑿𝟏𝒀𝟎𝑿𝟎 𝒀𝟏

𝒁𝟐 = 𝑿𝟎𝒀𝟏 ⨁ 𝑿𝟏𝒀𝟎

Circuito con compuertas lógicas para la salida 𝒁𝟐

Salida 𝒁𝟑

𝒁𝟑 𝒀𝟎 𝒀𝟏

𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏 𝒀𝟎 𝒀𝟏

𝑿𝟎 𝑿𝟏

0 0 0 0

𝑿𝟎 𝑿𝟏 0 1 1 0

𝑿𝟎 𝑿𝟏 0 1 1 0

𝑿𝟎 𝑿𝟏 0 0 0 0

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𝒁𝟑=𝑿𝟏𝒀𝟏

Circuito con compuertas lógicas para la salida 𝒁𝟑

Vista circuito general a implementar

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CONCLUSIONES

Se logró diseñar e implementar un circuito lógico que cumpliera las condiciones de

cálculo establecidas, al permitir realizar la multiplicación binaria de dos números de

dos bits.

Mediante la teoría vista en clase se pudo realizar el diseño del circuito de una forma

más eficiente y simplificada, para experimentar y comprobar los resultados

obtenidos.